HBM4的推出，逻辑芯片的制造工艺已罗致5纳米或更小的先进工艺，裁减了PNM本事的实施门槛。

跟着HBM4行将量产，存储器半导体行业正全力插足下一代本事“HBM-PNM”的磋磨。此举备受缓和，被视为为以“可考虑存储器”为中心的新时间作念准备，该时间径直在存储器里面管理考虑，突破了以显卡(GPU)为中心的架构的为止。

据业内东谈主士11日清爽，由三星电子、英伟达、加州大学圣地亚哥分校、哥伦比亚大学和延世大学构成的皆集磋磨团队最近在arXiv上发表了一篇对于AMMA（多芯片内存中心架构）本事的论文，展示了HBM-PNM本事的可行性。

PNM（近内存管理）本事通过将特殊的考虑单位扬弃在HBM堆栈的逻辑芯片上，径直在内存支配扩充考虑。现存的PIM（内存内管理）设施将考虑电路扬弃在存储单位里面，而PNM的上风在于梗概在保抓内存容量的同期，完了更复杂、更弘大的考虑。

现在，大型话语模子（LLM）办事的最大瓶颈在于解码阶段的耀视力机制。在对长高下文进行解码耀视力时，GPU进步95%的考虑才斡旋于闲置景色，导致内存带宽真的被充足愚弄。

即使是Rubin GPU，分析也自满，其考虑中枢（占封装面积的67%，功耗的73%）在遥远间运转的情况下本色愚弄率仅为4%至5%傍边。这变成了资源滥用，亦然导致功耗增多和发烧问题的主要原因。

跟着HBM4的推出，逻辑芯片的制造工艺已罗致5纳米或更小的先进工艺，裁减了PNM本事的实施门槛。该磋磨团队提议的AMMA决议移除了现存GPU的考虑芯片，并将16个HBM-PNM立方体以4×4网格结构畅达起来。这使得封装内的内存带宽培植至44TB/s，约为现存架构的两倍。

在本色磋磨中，与NVIDIA H100比较，AMMA架构将耀视力延长裁减了15.5倍，能耗裁减了6.9倍。其速率也比下一代Rubin GPU快1.8到2.5倍，能效提高了2.6到3.1倍。尤其值得一提的是，它在管理百万级（1M Context）的超长高下文推理和智能体责任负载方面发达出色。

磋磨团队示意：“通过这项磋磨，咱们旨在证明以内存为中心的架构有后劲成为GPU除外的新式架构，并促进对下一代系统的磋磨，在这些系统中，华游体育以内存为中心的加快器在异构平台中阐扬着要害作用。”

在摩尔定律的发展的几十年里，管理器、存储器等组件不休发展，管理器算力、存储器存储量都得到了大幅培植。但与之而来的，等于“存储墙”、“带宽墙”、“功耗墙”等问题。由于管理器的峰值算力每两年增长3.1倍，而动态存储器的带宽每两年增长1.4倍，存储器的发展速率远逾期于管理器，进出1.7倍。CPU时钟速率与片外内存和磁盘驱动器I/O速率之间的差距越来越大。比如，动态立时存储器DRAM（Dynamic Random Access Memory）是芯片范围“最大量单一家具”，精密工业制造的王冠之一，被喻为畅达中央管理器（CPU）的“数据高速公路”。其功能是暂存正在运转的各式设施和数据，是一种易失性存储器，即断电后数据就丢失。DRAM由于其较差的可膨胀性和极高的筹办本钱明锐性（每比特本钱），其发展相对较慢，在10nm本事节点就遇到了天花板。

存储墙导致访存时延高，成果低，存储器的数据探望速率跟不上管理器的数据管理速率，存算性能失配。为了破裂存储墙，也曾提议了无数的磋磨责任来优化DRAM架构，上文提到的近存考虑等于一种，此外还有存内考虑等路线。

存内考虑是在内存中完成部分考虑，在管理器中完成部分考虑。相较于内存考虑将考虑所需的所额外据放入到内存中，所有考虑由管理器完成，存内考虑裁减了数据在内存与高速缓存，高速缓存与CPU之间转移的能耗，提高内存考虑系统的性能。其中枢上风在于高算力、低功耗、低延长，主要分为端侧（小算力低功耗）、边侧（中算力及时管理）和云侧（高算力）。典型应用范围包括：结尾及物联网(IoT)场景、角落考虑及AI测度场景以及云霄/大范围考虑场景。

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